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精華集粹【一】:PCB任意角度布線的巧思及優(yōu)勢

發(fā)布時間:2015-01-11 責(zé)任編輯:echolady

【導(dǎo)讀】PCB布線的方式一直在加速改進(jìn),靈活地布線方式也多了起來。眾所周知,靈活地布線技術(shù)能夠有效地縮短導(dǎo)線長度,釋放更多的PCB空間。正因?yàn)閭鹘y(tǒng)的布線方式受到導(dǎo)向坐標(biāo)固定以及缺少角度的限制,但是現(xiàn)在人們不斷地改進(jìn)和提高,布線的質(zhì)量已經(jīng)有了明顯的提升。

任意角度布線的優(yōu)勢

任意角度布線有許多優(yōu)勢。首先,不使用線段間的角度可以節(jié)省PCB空間(多邊形所占的空間總是要大于內(nèi)切圓)。

傳統(tǒng)的自動布線器在緊鄰元件之間只能布3根線(見圖1中的左邊和中間)。而任意角度布線時的空間足以在相同路徑上布4根線而不違反設(shè)計(jì)規(guī)則檢查(DRC),見圖1右邊。

精華集粹:PCB任意角度布線的巧思及優(yōu)勢
圖1:左邊和中間的圖:傳統(tǒng)自動布線器在緊鄰元件之間只能布3根線。右圖:任意角度布線時的空間足以在相同路徑上布4根線而不違反DRC。

假設(shè)我們有一個正方式芯片,想把芯片引腳連接到另外兩列引腳(見圖2)。只使用90度夾角要占很大的面積(見圖2頂部)。

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圖2:正方形芯片布線:(頂部)正交版圖布線要求很大的面積;(中間)任意角度布線不僅有助于縮短導(dǎo)線長度,而且在確保滿足所有要求的同時占用更小的面積;(底部)旋轉(zhuǎn)芯片可以提供更好的效果,占用面積可以進(jìn)一步縮小兩倍以上。
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使用任意角度布線可以縮短芯片和其它引腳之間的距離(圖2中間),同時減小占用面積。在本例中,面積從30cm2縮小到了23cm2。

任意角度旋轉(zhuǎn)芯片還可以提供更好的效果。在本例中,面積從23 cm2縮小到了10 cm2(圖2底部)。圖3顯示了一塊真實(shí)的PCB。帶旋轉(zhuǎn)芯片功能的任意角度布線是這種電路板的唯一布線方法。這不僅是一個理論,也是得到實(shí)際應(yīng)用的解決方案(有時是唯一可行的解決方案)。

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圖3:帶旋轉(zhuǎn)芯片功能的任意角度布線是給這種電路板布線的唯一方法。
 
圖4顯示了一個簡單PCB的例子。拓?fù)洳季€器結(jié)果如圖4a所示,而基于最佳形狀的自動布線器結(jié)果如圖4b所示。圖4c是實(shí)際PCB的照片?;谧罴研螤畹淖詣硬季€器無法完成這種電路板的布線,因?yàn)樵恍D(zhuǎn)成任意角度放置。你需要更多的面積,如果不旋轉(zhuǎn)元件,設(shè)備必須做得更大。

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圖4:PCB布線例子:(a)拓?fù)涫阶詣硬季€器(完成了100%導(dǎo)線的布線);(b)基于最佳形狀的自動布線器(完成了56.3%的導(dǎo)線布線);(c)實(shí)際PCB。

電磁干擾(EMI)


如果沒有并行導(dǎo)線段,版圖性能將得到很大的提升,因?yàn)椴⑿袑?dǎo)線段經(jīng)常是串?dāng)_的來源。隨著并行導(dǎo)線長度的增長,串?dāng)_等級將呈線性增加。當(dāng)并行導(dǎo)線之間的間距增加時,串?dāng)_則呈二次方減小。讓我們把兩條并行的1mm長導(dǎo)線在間距為d時所產(chǎn)生的串?dāng)_等級設(shè)為e。

如果導(dǎo)線段之間有個夾角,那么當(dāng)這個夾角增加時,串?dāng)_等級將下降。這時的串?dāng)_不取決于導(dǎo)線長度,僅受限于夾角值:
如果沒有并行導(dǎo)線段,版圖性能將得到很大的提升,因?yàn)椴⑿袑?dǎo)線段經(jīng)常是串?dāng)_的來源。隨著并行導(dǎo)線長度的增長,串?dāng)_等級將呈線性增加。當(dāng)并行導(dǎo)線之間的間距增加時,串?dāng)_則呈二次方減小。讓我們把兩條并行的1mm長導(dǎo)線在間距為d時所產(chǎn)生的串?dāng)_等級設(shè)為e。 如果導(dǎo)線段之間有個夾角,那么當(dāng)這個夾角增加時,串?dāng)_等級將下降。這時的串?dāng)_不取決于導(dǎo)線長度,僅受限于夾角值: 其中α代表導(dǎo)線段之間的夾角。 圖5:如何導(dǎo)線段之間有個夾角,那么串?dāng)_等級將隨這個夾角的增加而減小(d:導(dǎo)線段之間的距離,α:導(dǎo)線段之間的夾角)。 下面考慮三種導(dǎo)線布線方式。在圖2中的左邊(90度布局),由于并行線段而存在最大的導(dǎo)線長度和最大的電磁干擾值。在圖2的中間(45度布局),導(dǎo)線長度和電磁干擾值都減小了。在圖2的右邊(任意角度),導(dǎo)線長度最短,也沒有并行的導(dǎo)線段,因此干擾值可以忽略不計(jì)。 圖6:三種導(dǎo)線布線方式。 因此任意角度布線有助于減小總的導(dǎo)線長度,并顯著減少電磁干擾。另外你應(yīng)該還記得對信號延時的影響吧(導(dǎo)線方向不應(yīng)該并行,并且不應(yīng)該垂直于PCB玻璃纖維方向)。
其中α代表導(dǎo)線段之間的夾角。

如果沒有并行導(dǎo)線段,版圖性能將得到很大的提升,因?yàn)椴⑿袑?dǎo)線段經(jīng)常是串?dāng)_的來源。隨著并行導(dǎo)線長度的增長,串?dāng)_等級將呈線性增加。當(dāng)并行導(dǎo)線之間的間距增加時,串?dāng)_則呈二次方減小。讓我們把兩條并行的1mm長導(dǎo)線在間距為d時所產(chǎn)生的串?dāng)_等級設(shè)為e。 如果導(dǎo)線段之間有個夾角,那么當(dāng)這個夾角增加時,串?dāng)_等級將下降。這時的串?dāng)_不取決于導(dǎo)線長度,僅受限于夾角值: 其中α代表導(dǎo)線段之間的夾角。 圖5:如何導(dǎo)線段之間有個夾角,那么串?dāng)_等級將隨這個夾角的增加而減小(d:導(dǎo)線段之間的距離,α:導(dǎo)線段之間的夾角)。 下面考慮三種導(dǎo)線布線方式。在圖2中的左邊(90度布局),由于并行線段而存在最大的導(dǎo)線長度和最大的電磁干擾值。在圖2的中間(45度布局),導(dǎo)線長度和電磁干擾值都減小了。在圖2的右邊(任意角度),導(dǎo)線長度最短,也沒有并行的導(dǎo)線段,因此干擾值可以忽略不計(jì)。 圖6:三種導(dǎo)線布線方式。 因此任意角度布線有助于減小總的導(dǎo)線長度,并顯著減少電磁干擾。另外你應(yīng)該還記得對信號延時的影響吧(導(dǎo)線方向不應(yīng)該并行,并且不應(yīng)該垂直于PCB玻璃纖維方向)。
圖5:如何導(dǎo)線段之間有個夾角,那么串?dāng)_等級將隨這個夾角的增加而減小(d:導(dǎo)線段之間的距離,α:導(dǎo)線段之間的夾角)。

下面考慮三種導(dǎo)線布線方式。在圖6中的左邊(90度布局),由于并行線段而存在最大的導(dǎo)線長度和最大的電磁干擾值。在圖6的中間(45度布局),導(dǎo)線長度和電磁干擾值都減小了。在圖2的右邊(任意角度),導(dǎo)線長度最短,也沒有并行的導(dǎo)線段,因此干擾值可以忽略不計(jì)。

如果沒有并行導(dǎo)線段,版圖性能將得到很大的提升,因?yàn)椴⑿袑?dǎo)線段經(jīng)常是串?dāng)_的來源。隨著并行導(dǎo)線長度的增長,串?dāng)_等級將呈線性增加。當(dāng)并行導(dǎo)線之間的間距增加時,串?dāng)_則呈二次方減小。讓我們把兩條并行的1mm長導(dǎo)線在間距為d時所產(chǎn)生的串?dāng)_等級設(shè)為e。 如果導(dǎo)線段之間有個夾角,那么當(dāng)這個夾角增加時,串?dāng)_等級將下降。這時的串?dāng)_不取決于導(dǎo)線長度,僅受限于夾角值: 其中α代表導(dǎo)線段之間的夾角。 圖5:如何導(dǎo)線段之間有個夾角,那么串?dāng)_等級將隨這個夾角的增加而減小(d:導(dǎo)線段之間的距離,α:導(dǎo)線段之間的夾角)。 下面考慮三種導(dǎo)線布線方式。在圖2中的左邊(90度布局),由于并行線段而存在最大的導(dǎo)線長度和最大的電磁干擾值。在圖2的中間(45度布局),導(dǎo)線長度和電磁干擾值都減小了。在圖2的右邊(任意角度),導(dǎo)線長度最短,也沒有并行的導(dǎo)線段,因此干擾值可以忽略不計(jì)。 圖6:三種導(dǎo)線布線方式。 因此任意角度布線有助于減小總的導(dǎo)線長度,并顯著減少電磁干擾。另外你應(yīng)該還記得對信號延時的影響吧(導(dǎo)線方向不應(yīng)該并行,并且不應(yīng)該垂直于PCB玻璃纖維方向)。
圖6:三種導(dǎo)線布線方式。

因此任意角度布線有助于減小總的導(dǎo)線長度,并顯著減少電磁干擾。另外你應(yīng)該還記得對信號延時的影響吧(導(dǎo)線方向不應(yīng)該并行,并且不應(yīng)該垂直于PCB玻璃纖維方向)。

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